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PCB布局与电源完整性把噪声扼杀在摇篮里原理图正确只是成功了30%。剩下的70%都在PCB布局上。对于FX10这种高速芯片电源分配网络PDN的设计好坏直接决定了系统能否稳定工作在10Gbps的速率下。3.1 分层策略与电源平面处理至少需要4层板这是底线。我强烈推荐6层板它能给你更从容的布局空间。一个典型的6层堆叠建议如下Top Layer主要放置FX10、关键阻容、高速信号走线尽量短。Layer2完整的地平面GND。这是所有高速信号回流的第一选择必须保持完整避免被切割。Layer3完整的电源平面如1.8V。专门给VDDD等1.8V网络使用。Layer4另一组电源平面如3.3V或关键信号层。Layer5完整的地平面GND。与Layer2形成地平面的耦合为内层信号提供屏蔽。Bottom Layer放置其他密度不高的器件、电源芯片及滤波电路。关键点为每一个主要的电源网络1.8V 3.3V都分配一个完整或至少是宽大的电源平面而不是用细线“拉”过去。平面的低阻抗特性能为芯片瞬间变化的大电流需求例如当LVDS接口突然涌入大量数据时提供低阻抗的泄放路径防止电压瞬间跌落IR Drop。3.2 退耦电容的“玄学”与科学退耦电容不是随便放几个0.1uF就完事的。它的作用是在电源芯片响应不及的瞬间纳秒级为芯片提供电荷维持电压稳定。我们需要一个从高频到低频的电容组合。** Bulk电容大容量电容**通常在电源入口或每个电源平面的入口处放置10μF到100μF的陶瓷电容应对低频电流波动。** 中频退耦电容**在芯片的每个电源引脚组附近放置1μF或2.2μF的电容。这是主力军。** 高频退耦电容**这是重中之重。必须在FX10的每一个电源引脚尤其是VDDD、VDDIO_P0/1、USB3V18到最近的地引脚之间放置一个0.1μF或0.01μF的电容。这个电容的摆放必须遵循“最近原则”——电容的GND端到芯片GND引脚的通路要尽可能短 ideally是直接打过孔到内层地平面。我习惯在PCB封装设计时就直接把这两个电容的焊盘作为FX10封装的一部分来规划。一个实测技巧你可以用示波器的带宽限制功能比如打开20MHz限制用探头尖和接地弹簧一定要用接地弹簧不要用长长的地线夹去测量芯片电源引脚上的纹波。一个优秀的PDN设计在满载工作下高频纹波20MHz应该被控制在30mVpp以内。3.3 地系统设计单点连接与分割整个系统最好采用单点接地或混合接地策略。数字地、模拟地USB PHY部分、电源地最终通过磁珠或0欧电阻在一点连接。在FX10芯片下方务必保证地平面的完整让所有信号的回流路径清晰、顺畅。对于USB接口和LVDS接口的屏蔽层要设计良好的接地方案通常通过电容和电阻网络连接到机壳地Chassis GND。4. LVDS与USB3.2信号完整性设计要点当电源足够“安静”后我们才能谈信号传输的质量。FX10的GPIF III接口支持LVDS这是为了应对高速数据流而生的。4.1 LVDS接口布线差分对的“共舞”LVDS是低压差分信号它的抗干扰能力来自于两根线P和N上方向相反的信号。因此保持这对信号的“一致性”是布线的黄金法则。等长差分对内的P线和N线长度必须严格等长我通常控制误差在5mil0.127mm以内。这能保证信号在接收端同时到达避免共模噪声转化为差模噪声。等距从驱动端到接收端两条线应始终保持平行、紧密耦合。线间距S最好保持恒定我一般设置为两倍线宽W即S2W。走线应避免不必要的过孔如果必须换层要为P和N同时打孔并在地孔附近增加回流地孔。阻抗控制LVDS差分阻抗标准通常是100Ω。这需要你和PCB板厂沟通通过调整线宽、线与参考地平面的距离介质厚度来实现。板厂会给你一个叠层结构图和阻抗计算参数一定要在投板前确认。远离干扰源LVDS走线要远离开关电源、晶振、时钟发生器等高噪声源。如果必须交叉要采用垂直交叉的方式。4.2 USB 3.2 Gen2布线更严格的挑战USB 3.2 Gen2的速率高达10Gbps其布线要求比LVDS更为苛刻。它同样是差分信号SSTX/-, SSRX/-。阻抗与长度差分阻抗需严格控制在90Ω。走线要尽可能短、直。从FX10的USB引脚到Type-C连接器的距离最好能控制在3英寸约7.6厘米以内越短越好。包地处理USB差分对建议用接地铜皮进行“包地”即在其两侧布上接地线并打过孔连接到地平面这能提供额外的屏蔽。远离其他信号USB差分对与其他任何信号线包括USB2.0的D/D-的间距至少要保持4倍线宽以上。绝对不要将高速USB走线布在晶振、时钟或开关电源的下方。连接器处的ESD保护在Type-C连接器的USB高速引脚附近必须放置专用的ESD保护二极管如USBLC6-2SC6并且其寄生电容要非常小通常0.5pF以免影响信号完整性。4.3 时钟信号的布局FX10需要外部24MHz晶振或时钟源。这个时钟的稳定性是整个系统同步的基础。晶振要尽可能靠近FX10的时钟输入引脚其下方所有层要挖空禁止走线形成一个“静默区”。时钟线要走成类差分形式如果有时钟和时钟反相输出并加串接一个小电阻22Ω-33Ω以减小反射。时钟电路的回流路径要单独、干净。经过这样一轮从电源架构到PCB走线的精心设计你的FX10硬件平台就拥有了一个坚实可靠的基础。我至今还记得当我把第一版问题板子上的电源滤波加强、LVDS走线按照上述规则重新优化后那块板子从之前传输大文件必出错变得可以连续数小时稳定跑满带宽。这种通过解决底层硬件问题带来的稳定感是后续所有软件调试乐趣的前提。在下一期我们将基于这个稳定的硬件一起搭建ModusToolbox开发环境并动手修改第一个SDK例程让FX10真正动起来。